AMD EPYC 9006 Venice relève les enjeux des CPU serveur avec Zen 6

AMD a dévoilé l’ensemble de la gamme AMD EPYC 9006 Venice, qui s’étend de processeurs professionnels à huit cœurs jusqu’à un fleuron serveur à 256 cœurs. Cette série intègre l’architecture Zen 6, de nouveaux sockets, 16 canaux mémoire et PCIe 6.0 à la prochaine plateforme serveur d’AMD.

Il ne s’agit pas d’une simple actualisation de processeurs. AMD divise Venice en plusieurs familles conçues pour répondre à des usages précis : informatique cloud dense, charges de travail techniques, serveurs d’entreprise classiques et nœuds hôtes pour l’IA.

Cette étendue modifie aussi le cadre concurrentiel. Intel reste le rival x86 historique d’AMD, mais le CPU Vera de Nvidia exerce désormais une pression sur AMD au sein même des racks d’IA. AMD doit défendre la compatibilité x86 tout en égalant la bande passante, l’efficacité et l’intégration au niveau système promises par des plateformes Arm étroitement intégrées.

Les premiers produits SP7 fixent le plafond technique. D’autres familles étendront la gamme jusqu’en 2027, notamment des systèmes SP8 plus compacts, des processeurs Venice-X riches en cache et une conception LPDDR5X appelée Verano.

Le résultat est un cycle produit qui se mesure en plateformes, et non à une seule date de lancement. Les acheteurs doivent donc distinguer les spécifications publiées par AMD des projections, de la disponibilité future et des affirmations de performances qui nécessitent encore des tests indépendants.

AMD EPYC 9006 Venice est une gamme, pas un seul processeur

AMD a conçu Venice comme plusieurs plateformes serveur apparentées, car une seule configuration de processeur ne convient plus à toutes les charges de travail des centres de données.

La famille principale AMD EPYC 9006 Venice utilise le nouveau socket SP7. Sa gamme comprend des processeurs Zen 6 conventionnels, des modèles haute fréquence et des puces Zen 6c denses affichant de très grands nombres de cœurs.

Zen 6c est la version d’architecture d’AMD axée sur la densité. Elle place davantage de cœurs dans une enveloppe de socket et de puissance réaliste, en privilégiant le débit global plutôt que la fréquence maximale par cœur.

Le fleuron EPYC 9996 associe 256 cœurs Zen 6c et 512 threads. AMD indique une fréquence de base de 2,55 GHz, des vitesses boost jusqu’à 4,1 GHz, 1 024 Mo de cache L3 et une puissance CPU par défaut de 600 watts.

Ce processeur se situe au-dessus de plusieurs alternatives denses. L’EPYC 9966 compte 192 cœurs, tandis que l’EPYC 9846 en possède 168. L’EPYC 9756 propose 128 cœurs avec des fréquences de base et boost plus élevées.

AMD propose également des processeurs destinés aux charges de travail qui privilégient moins de cœurs, mais plus rapides. Selon la gamme publiée, l’EPYC 9686F associe 96 cœurs à des vitesses boost atteignant 5 GHz.

Ces choix comptent, car les logiciels serveur évoluent rarement de manière uniforme. L’hébergement cloud peut bénéficier d’un plus grand nombre de machines virtuelles par socket, tandis que les systèmes de trading et les bases de données accordent souvent davantage d’importance à la latence et à la fréquence.

La gamme complète EPYC 9006 lineup reflète cette séparation. Elle offre aux opérateurs plusieurs compromis entre nombre de cœurs, fréquence, cache, bande passante mémoire et puissance du processeur.

Les systèmes SP7 peuvent exposer jusqu’à 16 canaux de mémoire DDR5 par socket. Ils prennent en charge les RDIMM classiques jusqu’à 8 000 MT/s et les MRDIMM jusqu’à 12 800 MT/s.

Une MRDIMM, ou DIMM à rangs multiplexés, combine les transferts de plusieurs rangs mémoire afin d’augmenter la bande passante effective. Cette technologie cible les serveurs dans lesquels les canaux mémoire classiques ne peuvent pas alimenter assez rapidement des nombres de cœurs croissants.

AMD affirme qu’un socket SP7 entièrement configuré peut fournir environ 1,6 To/s de bande passante mémoire avec des MRDIMM. Cette bande passante est critique lorsque 256 cœurs se disputent les données du même sous-système mémoire.

La plateforme introduit également PCIe 6.0, qui double le débit par voie de PCIe 5.0. Les spécifications d’AMD incluent jusqu’à 128 voies utilisables dans les configurations à un seul socket.

Cette connectivité laisse davantage de place aux GPU, adaptateurs réseau, unités de stockage et accélérateurs spécialisés. Elle réduit aussi le risque qu’un accélérateur coûteux attende derrière une connexion hôte sous-dimensionnée.

La segmentation de produits se poursuit au-delà de SP7. La famille SP8 d’AMD couvrira les déploiements d’entreprise plus compacts et à usage général, avec des configurations allant de huit à 128 cœurs.

Venice-X ajoutera la 3D V-Cache, qui empile du cache supplémentaire sous ou à côté des ressources de calcul du processeur. AMD la positionne pour la simulation, la modélisation et d’autres charges de travail techniques sensibles à la mémoire.

Verano emprunte une autre voie. Il associe jusqu’à 72 cœurs à 24 canaux de mémoire LPDDR5X, ciblant les nœuds hôtes d’IA qui ont besoin de bande passante et de coordination avec les accélérateurs.

La stratégie de portefeuille d’AMD reconnaît une réalité simple. Le meilleur CPU pour concentrer des machines virtuelles n’est pas automatiquement le meilleur CPU pour maintenir un vaste rack de GPU pleinement occupé.

Zen 6 change plus que le nombre de cœurs

La principale évolution de Venice est la combinaison, sur une même plateforme serveur, d’une puissance de calcul plus dense, d’une mémoire plus rapide et d’E/S de nouvelle génération.

AMD fabrique les chiplets de calcul Zen 6 sur le procédé N2 de TSMC. N2 utilise des transistors nanosheets gate-all-around, remplaçant la structure FinFET employée par plusieurs générations précédentes de processeurs.

AMD présente Venice comme le premier produit de calcul haute performance à atteindre une production de masse sur ce nœud. Cette description provient d’AMD et doit être considérée comme une affirmation de l’entreprise jusqu’à l’apparition de preuves plus larges d’expéditions.

Le changement de procédé favorise une densité de transistors supérieure, mais la technologie de gravure seule ne détermine pas les performances serveur. La conception du cache, le comportement des fréquences, l’accès mémoire, le firmware et la montée en charge des applications restent tout aussi importants.

La puce de calcul dense de Venice contient 32 cœurs Zen 6c et 128 Mo de cache L3. Huit de ces puces permettent au processeur fleuron d’atteindre 256 cœurs et 1 024 Mo de cache L3 total.

À titre de comparaison, l’EPYC 9965 de cinquième génération d’AMD culminait à 192 cœurs Zen 5c. Venice augmente donc le nombre maximal de cœurs d’un tiers tout en transformant également la plateforme environnante.

La conception Zen 6 standard répond à un objectif différent. AMD propose jusqu’à 128 cœurs Zen 6 complets, tandis que sa configuration à fréquence maximale s’arrête à 96 cœurs.

Cette segmentation offre aux équipes logicielles un choix significatif. Une charge de travail peut privilégier le parallélisme maximal, de meilleures performances par cœur ou un équilibre entre ces deux extrêmes.

La mémoire pourrait devenir la distinction la plus importante. Ajouter des cœurs sans pouvoir les alimenter peut produire un processeur impressionnant sur le papier, mais qui ralentit en conditions réelles.

Les Zen 6 platform details d’AMD indiquent jusqu’à 16 canaux DDR5 et des vitesses MRDIMM de 12 800 MT/s. La précédente plateforme Turin utilisait 12 canaux et une mémoire plus lente.

L’EPYC 9556 illustre la configuration grand public. AMD indique 64 cœurs, 128 threads, 384 Mo de cache L3 et une fréquence boost atteignant 4,3 GHz.

Ses processor specifications montrent également 16 canaux mémoire, une connectivité PCIe 6.0 et la prise en charge des RDIMM comme des MRDIMM. Ces fonctionnalités ne sont pas réservées au seul fleuron à 256 cœurs.

PCIe 6.0 est important, car les serveurs modernes déplacent des données entre plusieurs domaines de calcul. Les CPU coordonnent de plus en plus les accélérateurs, les réseaux à haut débit, le stockage composable et les dispositifs d’extension mémoire.

La prise en charge de CXL 3.1 étend ce rôle. Compute Express Link, ou CXL, fournit une connexion cohérente avec le cache pour les accélérateurs et les périphériques mémoire sur la couche physique PCIe.

Ces changements de plateforme expliquent pourquoi SP7 nécessite un nouveau socket. Les acheteurs ne peuvent pas considérer Venice comme une mise à niveau directe de processeur pour des serveurs SP5 existants.

Cette rupture engendre des coûts pour les fabricants de serveurs et leurs clients. De nouvelles cartes mères, de nouveaux firmwares, des validations du refroidissement, des qualifications mémoire et des processus de gestion de flotte doivent accompagner la transition des processeurs.

AMD a également remplacé sa terminologie familière de puissance thermique nominale par « Default CPU Power ». Cette nouvelle mesure couvre la puissance utilisée par les puces de calcul et d’E/S à l’objectif de performance indiqué.

Cette formulation mérite attention lors de la comparaison entre générations. La Default CPU Power et le TDP historique peuvent tous deux guider la planification, mais ils ne constituent pas automatiquement des mesures identiques.

La valeur de 600 watts du fleuron montre également la limite physique de la densité. Venice peut consolider davantage de travail par socket, mais chaque socket exige une alimentation électrique et un refroidissement substantiels.

Son meilleur argument d’efficacité dépendra du travail accompli par rack, non de la puissance indiquée à côté d’un processeur. Les tests au niveau serveur sont donc essentiels.

Nvidia Vera transforme la bataille des CPU en bataille des racks

Le principal défi d’AMD ne se limite plus à battre les processeurs Intel dans des serveurs conventionnels. L’entreprise doit défendre EPYC au sein de systèmes d’IA conçus comme des racks complets.

Intel reste important, car Xeon bénéficie toujours d’une vaste base installée, d’un support d’entreprise établi et de nombreuses certifications logicielles. Diamond Rapids apportera également des nombres de cœurs plus élevés et de nouvelles capacités de plateforme.

Cependant, Nvidia Vera modifie la compétition stratégique. Vera est un CPU basé sur Arm, conçu pour fonctionner étroitement avec les accélérateurs, la mémoire, les réseaux et les systèmes à l’échelle du rack de Nvidia.

Nvidia peut optimiser ces composants comme une seule plateforme. Cette approche concurrence le processeur d’AMD sur l’intégration, et pas seulement sur les résultats de benchmarks généralistes.

La réponse d’AMD commence par le débit. Ses documents publics comparent l’EPYC 9996 à 256 cœurs à Nvidia Vera, à Intel Xeon et aux précédents produits Turin d’AMD.

AMD affirme que son fleuron peut offrir 3,3 fois les performances au niveau du rack de Vera dans une enveloppe énergétique de 100 kilowatts. La rack performance methodology de l’entreprise repose en partie sur des projections et des configurations normalisées.

Cette distinction est cruciale. Un modèle de rack projeté est utile pour la planification d’architecture, mais il n’équivaut pas à des tests indépendants réalisés sur des systèmes de production.

AMD affirme également qu’un processeur Venice haute fréquence à 96 cœurs surpasse d’environ 20 % par cœur une configuration Vera à 88 cœurs. De récents benchmark reporting soulignent que ces résultats proviennent encore des tests d’AMD.

L’argument le plus fort de l’entreprise pourrait plutôt être la compatibilité x86. La plupart des logiciels d’entreprise et cloud fonctionnent déjà sur x86, souvent avec des années d’optimisation opérationnelle derrière eux.

Un passage à Arm peut nécessiter de nouvelles validations, des optimisations de performances différentes et un examen plus attentif du support des logiciels commerciaux. Pour certaines organisations, ces coûts peuvent l’emporter sur les gains matériels théoriques.

Toutefois, la compatibilité ne tranche pas la concurrence des nœuds hôtes d’IA. Nvidia peut soutenir que les clients achetant un système accéléré complet se préoccupent davantage du comportement du rack que de la continuité du jeu d’instructions du CPU.

Les CPU hôtes gèrent l’orchestration, la récupération, le réseau, le stockage, le prétraitement et l’exécution d’outils autour de l’inférence GPU. Un goulot d’étranglement du CPU peut donc laisser des accélérateurs coûteux sous-utilisés.

L’IA agentique ajoute davantage d’activité CPU, car une demande utilisateur peut déclencher plusieurs modèles, requêtes de bases de données, appels d’API et étapes de vérification. De nombreuses opérations ont lieu en dehors de l’accélérateur.

AMD présente Venice comme la fondation processeur de ces pipelines mixtes. L’entreprise affirme qu’une densité de cœurs plus élevée peut exécuter davantage de tâches d’agents isolées, tandis que les modèles haute fréquence peuvent gérer une orchestration sensible à la latence.

Cette proposition explique les différentes branches de Venice. Les modèles à 256 cœurs privilégient le travail simultané, tandis que les produits Zen 6 haute fréquence se concentrent sur le temps de réponse et la coordination des GPU.

Verano vise directement le discours de Nvidia sur la bande passante. Sa conception à 24 canaux LPDDR5X ressemble davantage à l’architecture mémoire des systèmes Arm orientés IA qu’à celle d’un serveur d’entreprise classique.

AMD prévoit d’utiliser des processeurs Venice haute fréquence dans Helios, sa plateforme IA à l’échelle du rack. Helios associe des CPU EPYC, des accélérateurs Instinct, le réseau Pensando et la pile logicielle d’AMD.

C’est le revirement stratégique à l’origine d’EPYC 9006. AMD a initialement gagné des parts sur le marché des serveurs en proposant aux clients un CPU alternatif au sein d’infrastructures x86 familières.

AMD doit désormais prouver qu’elle peut intégrer un rack IA complet sans sacrifier la flexibilité qui a fait l’attrait d’EPYC. Nvidia arrive par la direction opposée, en partant du rack intégré pour s’étendre au calcul généraliste.

Intel n’est pas absent de cette compétition, mais joue un rôle secondaire dans l’histoire actuelle de Venice. La pression immédiate provient de Nvidia, qui redéfinit les critères d’évaluation des clients.

Les acheteurs compareront de plus en plus les tokens, les agents ou les tâches terminées par rack. Ils examineront également l’énergie, la maturité logicielle, le taux d’utilisation et le délai de déploiement.

Un socket plus rapide ne compte que s’il améliore ces résultats à l’échelle du système.

Les affirmations de performance d’AMD doivent encore être prouvées en production

Les spécifications publiées sont substantielles, mais les comparaisons de performances les plus ambitieuses restent des résultats fournisseurs assortis d’importantes réserves.

AMD a fourni les détails de configuration de plusieurs tests Venice. C’est utile, car les benchmarks de serveurs peuvent changer considérablement selon le peuplement mémoire, les réglages du compilateur, le firmware et les limites de puissance.

L’entreprise a testé un système de référence EPYC 9996 avec 256 cœurs, de la mémoire DDR5-8000, le multithreading simultané et un réglage de puissance par défaut de 600 watts. Elle a utilisé Ubuntu et une configuration orientée performances d’AMD.

Les résultats publiés par AMD pour les charges de travail agentiques incluent également des systèmes Intel Xeon et AWS Graviton. Toutefois, la configuration cloud introduit des variables qui n’apparaissent pas dans les comparaisons directes en laboratoire.

AMD souligne elle-même que les résultats cloud peuvent varier selon la disponibilité régionale, la virtualisation, le stockage, le réseau et la configuration du service. Elle avertit aussi que les résultats cloud et ceux de serveurs physiques ne sont pas nécessairement directement comparables.

Ces informations ne rendent pas les tests invalides. Elles limitent les conclusions que les lecteurs devraient en tirer.

L’affirmation d’un rack 3,3 fois plus performant comporte une réserve supplémentaire. Elle modélise le nombre de systèmes pouvant tenir dans un budget énergétique défini, puis combine ce nombre à une estimation des performances par nœud.

Une telle modélisation peut mettre en évidence un avantage réel de densité. Elle peut aussi amplifier les hypothèses concernant l’utilisation, la surcharge de refroidissement, la mémoire, le réseau et le comportement soutenu des applications.

Les systèmes de production nécessitent des tests sur des charges de travail plus variées. Les bases de données, les services Java, la virtualisation, le calcul scientifique, la compilation, les services web et l’orchestration IA sollicitent les processeurs de façons différentes.

Les licences logicielles introduisent une autre complication. Les produits sous licence par cœur peuvent rendre un socket à 256 cœurs économiquement peu attrayant, même lorsque le matériel accomplit davantage de travail.

À l’inverse, les licences par socket ou par serveur peuvent rendre les processeurs denses très intéressants. Un système Venice pourrait remplacer plusieurs serveurs plus anciens tout en réduisant la surcharge réseau et d’administration.

La densité de puissance présente un compromis similaire. La consolidation des serveurs peut réduire la consommation énergétique totale, mais un processeur de 600 watts concentre la chaleur dans chaque châssis.

Les opérateurs doivent vérifier si l’alimentation électrique existante des racks, le flux d’air, le refroidissement liquide et les procédures de maintenance peuvent accueillir ces configurations. L’efficacité d’un processeur ne peut pas compenser un rack dépourvu d’un refroidissement suffisant.

L’économie de la mémoire compte également. Atteindre une bande passante maximale nécessite le bon type et le bon peuplement de DIMM, tandis que la capacité maximale peut imposer des limites de vitesse différentes.

Les MRDIMMs promettent des débits de transfert bien plus élevés, mais les acheteurs ont besoin de validations couvrant le firmware, les plateformes serveur et les profils de charge de travail. Le comportement en matière de latence compte autant que les chiffres de bande passante mis en avant.

PCIe 6.0 apporte une autre transition. La norme double le débit, mais l’intégrité du signal devient plus difficile à assurer à des vitesses supérieures, ce qui renforce l’importance de la conception des cartes et des retimers.

Les nouveaux accélérateurs et périphériques réseau doivent également prendre en charge l’interface plus rapide avant que chaque voie n’apporte une valeur pratique. Les premiers systèmes peuvent embarquer cette capacité avant que les périphériques environnants ne l’exploitent pleinement.

La feuille de route introduit un risque de disponibilité. SP7 peut ouvrir la gamme, mais SP8, Venice-X et Verano arriveront selon des calendriers différents qui s’étendent jusqu’à la fin de 2027.

Ce lancement échelonné signifie qu’« EPYC 9006 » ne décrit pas une fenêtre d’achat uniforme. Un client attendant des modèles riches en cache ou LPDDR5X fait face à un calendrier différent.

Cela donne aussi aux concurrents le temps de réagir. Nvidia peut affiner les systèmes Vera, tandis qu’Intel peut positionner Diamond Rapids face aux produits Venice ultérieurs.

La couverture de la feuille de route d’AMD montre à quel point Venice est étroitement lié à Helios et aux futures plateformes de racks. Ce lien renforce l’argumentaire système d’AMD, mais alourdit la charge d’exécution.

AMD doit livrer des processeurs, cartes, prise en charge mémoire, réseau, accélérateurs, firmware et logiciels selon des calendriers coordonnés. Un retard sur un composant peut affaiblir l’avantage du rack complet.

Les tests indépendants devraient répondre à quatre questions centrales. Les évaluateurs doivent mesurer le débit soutenu, les performances par cœur, la montée en charge de la mémoire et le travail achevé par watt.

Ils devraient également comparer des systèmes équivalents. Des systèmes d’exploitation, compilateurs, capacités mémoire et configurations d’accélérateurs identiques rendront les résultats plus crédibles.

En attendant ces tests, les spécifications montrent l’intention architecturale d’AMD. Elles n’établissent pas encore le résultat pour chaque charge de travail de production.

Ce qu’il faut surveiller alors que la feuille de route Venice s’étend jusqu’en 2027

Trois signaux montreront si AMD EPYC 9006 Venice devient un avantage durable de plateforme ou une impressionnante fiche technique.

Le premier signal est la disponibilité généralisée de SP7 dans des serveurs de production. Les processeurs annoncés ne comptent que lorsque les clients peuvent obtenir des systèmes qualifiés auprès de plusieurs fournisseurs, dans des volumes prévisibles.

Dell, HPE, Lenovo, Cisco et Supermicro figurent dans les documents partenaires d’AMD. Leurs configurations commercialisées révéleront quels modèles de processeurs, vitesses mémoire et combinaisons d’accélérateurs sont réellement viables au lancement.

Surveillez le nombre de systèmes prenant en charge 16 canaux mémoire entièrement peuplés et des MRDIMMs à haute vitesse. Une qualification limitée affaiblirait le discours d’AMD sur la bande passante, même si le processeur prend en charge cette fonctionnalité.

La maturité du firmware compte tout autant. Les premières révisions de BIOS peuvent affecter le comportement du boost, la compatibilité mémoire, la virtualisation, les contrôles de sécurité et la régularité des performances.

Le déploiement dans le cloud offre un autre indicateur utile. Les grands fournisseurs exposent les processeurs à des charges de travail diverses et facilitent les comparaisons grâce à des familles d’instances standardisées.

Si les principaux clouds lancent rapidement des instances Venice, AMD obtient une preuve accessible de la demande et de la préparation opérationnelle. Une disponibilité lente suggérerait des frictions d’approvisionnement, de validation ou de plateforme.

Le deuxième signal est la comparaison indépendante avec Nvidia Vera et la prochaine génération Xeon d’Intel. Les projections des fournisseurs ne peuvent pas trancher la compétition à l’échelle du rack.

Les tests devraient mesurer davantage qu’un unique benchmark CPU. Les évaluations utiles incluront les services web, les bases de données, la densité de virtualisation, le traitement des données, la récupération IA et l’utilisation des nœuds hôtes GPU.

Pour l’infrastructure IA, la mesure décisive est le travail achevé sur l’ensemble du système. Cela inclut la préparation par le CPU, l’exécution par les accélérateurs, le réseau, le stockage et la livraison des réponses.

Si Venice maintient davantage d’accélérateurs occupés dans la même limite de puissance par rack, l’architecture d’AMD gagne en crédibilité. Si Vera l’emporte grâce à une intégration plus étroite, l’avantage d’AMD en nombre de cœurs devient moins décisif.

La réponse d’Intel testera une autre partie de la stratégie. Une forte disponibilité de Diamond Rapids pourrait mettre AMD sous pression sur la bande passante mémoire, la qualification en entreprise et les déploiements x86 à très grand nombre de cœurs.

Le troisième signal est la capacité d’AMD à livrer le reste du portefeuille dans les délais. SP8, Venice-X et Verano portent une grande partie de l’affirmation selon laquelle EPYC 9006 couvre tous les rôles serveur.

SP8 doit montrer qu’AMD peut réduire l’échelle de la conception sans conserver des coûts de plateforme inutiles. Les petites entreprises ont besoin de systèmes équilibrés, et non seulement de versions réduites de matériel hyperscale.

Venice-X doit justifier son cache empilé par des gains mesurables en simulation et en calcul technique. Sa valeur dépendra de la sensibilité aux charges de travail, de la fréquence et du comportement mémoire.

Verano pourrait devenir le produit le plus révélateur. Son sous-système LPDDR5X répond directement à l’architecture axée sur la bande passante qui donne à Vera son importance stratégique.

Si Verano arrive à temps et se comporte bien comme CPU hôte pour l’IA, AMD aura répondu à Nvidia par davantage que la continuité x86 conventionnelle. Elle aura adapté EPYC à l’ère des racks à grande échelle.

Si les produits ultérieurs prennent du retard, Nvidia gagne du temps pour renforcer sa plateforme intégrée. Intel bénéficie également d’une ouverture plus large pour concurrencer avec sa prochaine génération de serveurs.

Pour les acheteurs en entreprise, la décision immédiate ne consiste pas simplement à savoir si Venice dispose de plus de cœurs. Il s’agit de déterminer si une nouvelle plateforme SP7 s’aligne sur les charges de travail et le calendrier de remplacement de l’organisation.

Les équipes devraient recenser les licences logicielles, la bande passante mémoire, la demande par cœur, la connectivité des accélérateurs, la capacité de refroidissement et les possibilités de consolidation des sockets. Ces facteurs déterminent si un processeur dense génère des économies ou déplace le goulot d’étranglement ailleurs.

Les groupes d’ingénierie qui évaluent la plateforme devraient conserver les notes de benchmark, les révisions de firmware et les affirmations des fournisseurs dans une base de connaissances technique consultable. Des enregistrements comparables deviennent précieux lorsque les spécifications et les logiciels évoluent au cours d’un long déploiement.

Le lancement d’AMD EPYC 9006 Venice clarifie la direction d’AMD. Zen 6 étend les ambitions de l’entreprise dans les serveurs, des CPU individuels vers plusieurs plateformes spécifiques aux charges de travail.

La responsabilité passe désormais de l’architecture à l’exécution. Les acheteurs devraient surveiller la disponibilité réelle des systèmes, les tests indépendants de racks et la livraison du portefeuille 2027 avant de considérer les avantages projetés par AMD comme établis.

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